Verilog HDL論理合成入門 : RTL記述&ネットリストのリファレンス

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Verilog HDL論理合成入門 : RTL記述&ネットリストのリファレンス

フォーマット:

図書

責任表示:

Jayaram Bhasker著 ; 佐々木尚訳

言語:

日本語

出版情報:

東京 : CQ出版, 2001.5

形態:

203p ; 24cm

著者名:

シリーズ名:

Design wave books <BN12037320>

書誌ID:

BA52081133

ISBN:

9784789833547 [4789833542]

子書誌情報

所蔵情報

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詳細

その他の標題:	Verilog HDL synthesis : a practical primer
主題:	電子計算機; 電子計算機--プログラミング
分類・件名:	NDC8 : 548.2 NDC9 : 548.2 BSH : 電子計算機 BSH : 電子計算機 -- プログラミング
タイトルのヨミ、その他のヨミ:	Verilog HDL ロンリゴウセイニュウモン : RTL キジュツ & ネットリストノリファレンス
TTLL:	jpn
著者名ヨミ:	ササキ, ヒサシ

内容紹介

目次情報

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